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Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: COVEST-COPSET
Orgão: UFPE
Qual o barramento responsável pela comunicação entre os circuitos que compõem a arquitetura de pontes dos chipsets da placa-mãe?
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Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: COVEST-COPSET
Orgão: UFPE
é um equipamento capaz de manter o computador ligado durante algum tempo no caso de falta de luz. Classifica-se em dois tipos: e . Enquanto no primeiro tipo não ocorre retardo quando acionado; no segundo tipo, este retardo não apenas existe, como também pode possuir um de tensão incorporado, como no caso do . Assinale a alternativa que preenche corretamente as lacunas:
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Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: COVEST-COPSET
Orgão: UFPE
Qual a técnica que possibilita dispositivos PCI transferirem dados diretamente à memória, sem a necessidade de uso do processador?
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Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: COVEST-COPSET
Orgão: UFPE
Dadas 6 (seis) partições de memória vazias na seguinte ordem de tamanho: 280K, 590k, 330k, 190k, 730k, 120k; e 5 (cinco) processos na seguinte ordem de tamanho: 110k, 295k, 333k, 190k e 311k; qual a sequência de partições de memória vazias após a aplicação do algoritmo de alocação de memória do pior caso (worst-fit)? Obs.: A ordem de atendimento dos processos deve obedecer à sequência (a ordem) acima descrita, portanto, da esquerda para direita.
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Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: COVEST-COPSET
Orgão: UFPE
P1, P2 e P3 são três processos que aparecem simultaneamente no tempo 0 (zero). Além disso, considere que P1, P2 e P3 têm, respectivamente, os seguintes tempos de processamento (em milissegundos): 25, 4 e 4. Sendo assim, em qual tempo o processo P1 conclui seu processamento segundo o algoritmo de escalonamento Round Robin (RR), considerando: (a) um quantum (fatia) de tempo de 5 milissegundos e (b) uma ordem na fila de atendimento no tempo 0 (zero) em que P1 é o primeiro processo a ser atendido, P2 é o segundo e P3, o terceiro?
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Identifique como paralela ou serial as seguintes tecnologias de barramento internas ou externas: MBus, PCIe, VESA, GPIB (ou IEEE-488), EIA-485, respectivamente.
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Qual a forma básica de sincronização entre um processador e um dispositivo de entrada/saída, na qual o processador verifica repetidamente se uma operação foi completada antes de iniciar a próxima operação?
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Qual tecnologia RAM (Random Access Memory) usa um circuito que age como um capacitor?
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Qual a sequência correta e completa referente aos passos usados para traduzir um programa-fonte em uma representação de código de objeto binário, usado por um processador?
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Banca: COVEST-COPSET
Orgão: UFPE
Assinale a alternativa que indica o tipo de memória que deve ser expandido para melhorar o desempenho de um computador que é usado exclusivamente para ler e escrever poucos dados, mas é extremamente exigido para realizar muitas comparações e cálculos complexos.
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