4140621 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Informática/Programação de Sistemas
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Memória e Armazenamento

Considere um sistema computacional no qual o processador possui um barramento de endereços de 20 bits e um barramento de dados de 8 bits. Nesse sistema, a memória é endereçada por byte. Com base nessas características da arquitetura, assinale a alternativa correta.

A

O sistema pode endereçar até 2 MB de memória principal.

B

A memória principal máxima que pode ser endereçada pelo processador é de 512 KB.

C

A memória principal máxima que pode ser endereçada pelo processador é de 1 MB.

D

O barramento de dados determina a quantidade máxima de memória que pode ser endereçada.

E

O barramento de dados de 8 bits implica que a memória deve ser organizada em palavras de 8 bytes.

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4140592 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Informática/Hardware e Redes
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Sobre as três técnicas fundamentais de realização de E/S em sistemas computacionais — E/S programada, E/S orientada a interrupções e acesso direto à memória (DMA – Direct Memory Access) —, assinale a alternativa correta.

A

Na E/S orientada a interrupções, a CPU inicia a operação e fica bloqueada, aguardando a interrupção do dispositivo. Durante esse tempo de espera, o núcleo não pode executar outros processos, pois o contexto permanece travado até a conclusão da E/S.

B

A principal vantagem do DMA é eliminar completamente as interrupções: o controlador de DMA conclui toda a transferência sem gerar qualquer interrupção à CPU.

C

O DMA reduz as interrupções de uma por dado transferido para uma por buffer; exige hardware especial (controlador de DMA), mas libera a CPU para outros trabalhos ao longo da operação de E/S.

D

A principal desvantagem da E/S orientada a interrupções é que o processador deve permanecer dedicado à operação de E/S durante toda a transferência, sem poder executar outros processos.

E

Na E/S programada, após iniciar a transferência, a CPU é suspensa por interrupção do dispositivo, retomando a execução somente ao término da operação.

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4140586 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Informática/Hardware e Redes
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Memória e Armazenamento

Acerca das tecnologias de memória semicondutora, assinale a alternativa correta sobre as diferenças entre SRAM e DRAM e suas aplicações na hierarquia de memória.

A

A DRAM utiliza flip-flops para armazenar dados, sendo mais rápida que a SRAM e adequada para implementar memórias cache.

B

A SRAM é uma memória não volátil: por usar flip-flops para armazenar bits, ao contrário da DRAM, que requer refresh periódico, ela mantém os dados mesmo após o desligamento do equipamento.

C

A SRAM utiliza flip-flops, dispensa refresh e apresenta, em geral, menor tempo de acesso que a DRAM, sendo empregada na memória cache.

D

A DRAM é preferida para cache por ser mais rápida que a SRAM e dispensar refresh periódico.

E

SRAM e DRAM são memórias não voláteis; a DRAM, em particular, requer exposição à luz ultravioleta antes de cada operação de gravação.

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4140582 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Informática/Hardware e Redes
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ProcessadoresCiclo de InstruçãoPipeline de Instruções

Sobre o pipeline de instrução e seus hazards, assinale a alternativa correta.

A

Um hazard de recursos ocorre quando uma instrução de desvio condicional está em execução no pipeline, e o processador não pode determinar qual instrução buscar a seguir, pois o endereço de destino do desvio ainda não foi calculado.

B

O hazard de controle, também conhecido como hazard de desvio, ocorre quando o endereço da próxima instrução a ser buscada depende do resultado de uma instrução de desvio ainda em execução no pipeline.

C

Um hazard de dados ocorre quando duas ou mais instruções em estágios simultâneos precisam do mesmo recurso de hardware, exigindo serialização parcial do pipeline.

D

As estratégias de previsão de desvio “previsão sempre tomada” e “previsão nunca tomada” são dinâmicas: dependem do histórico de execução das instruções de desvio anteriores.

E

A inserção de ciclos ociosos (stalls) é a única solução possível para hazards de dados; o encaminhamento de dados (forwarding) é uma técnica exclusiva de tratamento de hazards de controle, não sendo aplicável a hazards de dados.

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4140377 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Ciências da Computação
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Memória e ArmazenamentoRAID

Sobre os níveis RAID 5 e RAID 6 (Redundant Array of Independent Disks), assinale a alternativa correta em relação aos mecanismos de tolerância a falhas e ao desempenho de leitura de cada nível.

A

RAID 5 distribui dois blocos de paridade independentes por faixa — esquema P+Q calculado com código Reed-Solomon —, tolerando a falha simultânea de quaisquer dois discos do conjunto; RAID 6 usa paridade simples distribuída e tolera a falha de apenas um disco.

B

RAID 6 armazena dois discos inteiros dedicados exclusivamente à paridade — sem intercalar dados nesses discos —, concentrando neles todo o gargalo de escrita; RAID 5 distribui a paridade uniformemente entre todos os discos para eliminar esse gargalo.

C

No RAID 5, a recuperação após falha de um disco é realizada por espelhamento: cada disco de dados possui uma cópia exata armazenada em outro disco do conjunto; no RAID 6, dois discos são espelhados para ampliar a proteção a duas falhas simultâneas.

D

RAID 5 e RAID 6 possuem a mesma tolerância a falhas: ambos toleram a falha simultânea de qualquer par de discos do conjunto. A diferença entre os dois níveis está apenas na quantidade de discos exigidos para compor o conjunto mínimo.

E

RAID 5 distribui paridade simples entre todos os discos do conjunto e tolera a falha de um único disco; RAID 6 armazena dois blocos de paridade independentes por faixa, calculados via Reed-Solomon (esquema P+Q), e tolera a falha simultânea de quaisquer dois discos do conjunto, mantendo leitura paralela nos discos restantes.

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4140376 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FUNDATEC
Orgão: IFC

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Professor PEBTT - Ciências da Computação
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Representação de Dados

A representação de inteiros em complemento de dois é o esquema padrão adotado em processadores modernos para representar inteiros com sinal. Considere um inteiro com sinal representado em n bits utilizando esse sistema. Nesse contexto, assinale a alternativa correta.

A

O intervalo de valores representáveis é simétrico em relação ao zero: de −(2⁽ⁿ⁻¹⁾ − 1) a +(2⁽ⁿ⁻¹⁾ − 1), pois o padrão reserva 1 bit exclusivamente para o sinal e utiliza os demais n−1 bits para a magnitude absoluta do valor.

B

O valor zero possui duas representações distintas no sistema complemento de dois: uma com bit de sinal 0 e outra com bit de sinal 1.

C

A negação de um número em complemento de dois é obtida invertendo todos os seus bits, sem necessidade de qualquer operação adicional.

D

O intervalo de representação cobre exatamente 2⁽ⁿ⁺¹⁾ valores distintos, de −2ⁿ a +(2ⁿ − 1), pois cada bit adicional dobra o espaço representável e o sistema de complemento de dois não desperdiça nenhuma combinação de bits.

E

A negação do menor inteiro representável no sistema — o valor mais negativo — provoca overflow, pois o valor positivo correspondente excede o limite superior do intervalo.

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4139025 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: IGEDUC
Orgão: Pref. Pão Açúcar-AL

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Técnico de Informática
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Hardware

A transição do BIOS (Basic Input/Output System) para o UEFI (Unified Extensible Firmware Interface) trouxe melhorias significativas na inicialização e segurança dos sistemas. Sobre as características e configurações de firmware em estações de trabalho modernas, analise as seguintes proposições:
I. O UEFI suporta o particionamento GPT (GUID Partition Table), permitindo a inicialização de discos rígidos com capacidades superiores a aproximadamente 2,2 Terabytes (TB) ou 2 Tebibytes (TiB).
II. O recurso "Secure Boot" no UEFI impede a execução de carregadores de inicialização (bootloaders) que não possuam uma assinatura digital válida e confiável.
III. A atualização de firmware (BIOS Flash) é um procedimento isento de riscos, pois o sistema operacional mantém uma cópia de segurança automática do firmware anterior.
Está correto o que se afirma em:

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4139021 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: IGEDUC
Orgão: Pref. Pão Açúcar-AL

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Técnico de Informática
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Memória e Armazenamento
ProcessadoresComponentesRegistradores

A arquitetura de Von Neumann fundamenta a maioria dos computadores modernos utilizados na administração pública. Sobre a organização e o funcionamento da Unidade Central de Processamento (UCP) e a hierarquia de memória, assinale a alternativa CORRETA que descreve o papel dos registradores e da memória cache no ciclo de instrução.

A

O barramento de endereços é bidirecional e permite que o processador receba dados da memória principal enquanto envia endereços para os dispositivos de entrada.

B

O ciclo de instrução consiste exclusivamente nas etapas de busca e execução, sendo que a decodificação ocorre apenas em arquiteturas RISC devido à sua complexidade.

C

A Unidade Lógica e Aritmética (ULA) é responsável por coordenar o fluxo de dados entre os periféricos de entrada e saída, sem realizar operações matemáticas diretas.

D

Os registradores são memórias de alta velocidade localizadas fora do processador, destinadas ao armazenamento temporário de grandes volumes de dados durante a execução.

E

A memória cache atua como um buffer entre o processador e a memória RAM, visando reduzir o tempo médio de acesso aos dados através dos princípios da localidade espacial e temporal.

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4139019 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: IGEDUC
Orgão: Pref. Pão Açúcar-AL

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Técnico de Informática
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HardwareManutenção de Computadores

A Descarga Eletrostática (ESD) representa um risco invisível, porém significativo, para a integridade dos componentes eletrônicos durante procedimentos de manutenção. Sobre as normas de segurança e as práticas de prevenção de danos por eletricidade estática, analise as seguintes proposições:
I. O uso de pulseira dissipativa, desde que conectada a um sistema de aterramento adequado e funcional, auxilia na equalização do potencial elétrico entre o técnico e a bancada de trabalho, mitigando o risco de descargas abruptas.
II. Em procedimentos de controle de Descarga Eletrostática, recomenda-se que componentes sensíveis, como processadores e módulos de memória, sejam manuseados preferencialmente pelas suas bordas laterais, evitando-se o toque direto em seus contatos metálicos ou circuitos integrados.
III. Tapetes dissipativos e ferramentas ESD-safe (condutivas ou dissipativas) são elementos essenciais na composição de uma Área de Proteção Contra Descarga Eletrostática (APDE) em uma bancada profissional.
Está correto o que se afirma em:

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4133629 Ano: 2026
Disciplina: TI - Organização e Arquitetura dos Computadores
Banca: FAFIPA
Orgão: Pref. Rio Branco Sul-PR

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Procurador
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HardwareBarramentos

No contexto de hardware e barramentos de entrada e saída, a tecnologia NVMe (Non-Volatile Memory Express) representa uma evolução significativa em relação ao padrão SATA. Qual a principal razão técnica para a superioridade de desempenho do NVMe em sistemas modernos?

A

A capacidade de operar via barramento PCI Express (PCIe), permitindo maior largura de banda e menor latência de comunicação direta com a CPU.

B

A substituição de circuitos integrados por discos magnéticos de alta rotação (acima de 15.000 RPM).

C

A obrigatoriedade de instalação externa via porta USB 2.0 para evitar o superaquecimento da placamãe.

D

O uso exclusivo de cabos de fibra otica para conectar o drive à fonte de alimentação.

E

O fato de ser um hardware periférico de saída que não exige o uso de memória RAM para processar dados.

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